cj-02FPGA的发展和展望
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cj-03Verilog模块的设计流程
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cj-04设计一个十六位加法器
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CJ-05FPGA设计原则和技巧01
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CJ-06FPGA设计原则和技巧02
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CJ-07 IP核的使用
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CJ-08 Verilog HDL的建模
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CJ-09 D型触发器的verilog代码和Testbench的编写
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CJ-10 BCD码编码器_逐步移位法
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cj-11状态机
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